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十年FPGA開發經驗工程師肺腑之言
在學習一門技術之前我們往往從它的編程語言入手，比如學習單片機時，我們往往從匯編或者C語言入門。所以不少開始接觸FPGA的開發人員，往往是從VHDL或者Verilog開始入手學習的。但我個人認為，若能先結合《數字電路基礎》系統學習各種74系列邏輯電路，深刻理解邏輯功能，對于學習HDL語言大有裨益，往往會起到事半功倍的效果。
2016-10-27
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適用于 FPGA、GPU 和 ASIC 系統的電源管理
分析和解決問題的負擔常常落在系統設計師的肩上。配置設計方案復雜的數字部分已經占據了這些設計師的大部分精力。因此處理設計方案的模擬和電源部分就成了主要挑戰，因為電源并非如很多設計師所預期的那樣是個簡單的任務。
2016-10-26
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例解電路去耦技術，看了保證不后悔
如果電源引腳上存在紋波和/或噪聲，大多數IC都會有某種類型的性能下降。數字IC的噪聲裕量會降低，時鐘抖動則可能增加。對于高性能數字IC，例如微處理器和FPGA，電源額定容差(例如±5%)包含直流誤差、紋波和噪聲之和。只要電壓保持在容差內，數字器件便符合規范。
2016-10-21
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FPGA和音頻處理器實現獨特工業應用
自現場可編程邏輯器件(FPGA)面世以來，通常瞄準最大的市場區間——通信行業。雖然大多數FPGA開發人員仍然以通信應用為重點，但他們越來越多地關注存儲和服務器市場，尤其是日益增長的音頻處理，通過結合音頻處理器的功能和FPGA器件的靈活性，能夠支持許多創新應用。
2016-10-18
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FPGA與ASIC，誰將引領移動端人工智能潮流？
人工智能方興未艾，無數初創公司和老牌公司都在積極開發以人工智能應用為賣點的智能硬件。目前，強大的云端人工智能服務（如谷歌的Alpha Go）已經初現端倪，同時，人們也希望能把人工智能也帶到移動終端，尤其是能夠結合未來的物聯網應用。
2016-10-17
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FPGA提升電機控制系統的性能和設計靈活性
電動機總體上消耗了很大一部分的全球電力,從而帶來了更復雜的電機控制設計，這些設計使用基于傳感器和無傳感器反饋回路和先進的算法，實現更精密的控制和更高的電機效率。
2016-09-22
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相移時延如何改善DC/DC轉換器性能？
在大多數需要通過單一輸入源調節多路輸出電壓的步降電源轉換應用中，開關穩壓器會在向FPGA、DSP和微處理器提供負載點（POL）電源時，施加高輸入均方根（RMS）電流和噪聲。為解決此問題，設計工程師通常會采用高輸入濾波（但有附加成本），以減輕傳導型電磁干擾（EMI）和/或輻射型電磁干擾，同時對較高的系統I2R功率損耗加以控制。
2016-09-20
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不用處理器控制FPGA總線的方法
許多FPGA設計使用嵌入式處理器實現控制。典型的解決方案是使用Nios這樣的軟處理器，雖然內置硬處理器的FPGASoC也變得很流行了。圖1顯示的是一個典型的Altera FPGA系統，其中包含了處理器和通過Altera的Avalon內存映射(MM)總線連接的各種外設。這些處理器極大地簡化了終端應用，但要求很強的編程背景和復雜的工具鏈知識。這將妨礙調試，特別是當硬件工程師不想求助軟件工程師，只需要一種簡單的方式讀寫外設時。
2016-08-10
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面積緊湊的PCB也可實現高功率數字控制與遙測功能
對于任何人來說，數字電源系統管理 (DPSM) 在通信和計算機行業內的持續采用，在很大程度上繼續由位于其系統架構核心的 20nm 以下 ASIC 和 / 或 FPGA 所需之高電流水平驅動都是不足為奇的。我們以下一代數據中心交換機中使用的最新 ASIC 為例來說明。
2016-07-21
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FPGA和CPLD內部自復位電路設計方案
復位信號是時序電路設計的基本信號，本文描述了復位的定義，分類及不同復位設計的影響，并討論了針對FPGA和CPLD的內部自復位方案。
2016-07-12
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未來的FPGA可應對智能電網的挑戰
傳統的電力基礎設施在本質上是低效的，伴隨著設備老齡化的來臨，這些設備頻繁的損壞，不光是資產及設備造成損失，同時也會對整個電網其他設備造成嚴重的影響。“智能電網”則可以解決上述挑戰。
2016-03-30
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可實現的拾取和預處理：基于SoC FPGA的心電信號檢測系統設計
本設計實現了一種基于片上系統現場可編程門陣列(SoC FPGA) 的心電信號(ECG)檢測系統。系統通過具有高輸入阻抗、高共模抑制比和低噪聲的前置采集放大電路，實現心電信號的拾取和預處理。
2016-02-16
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